Quarus中创建硬件描述语言（HDL）的注意事项

宁静_致远_

于 2021-11-22 17:49:58 发布

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分类专栏：电子文章标签： fpga开发

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这篇博客介绍了如何使用Verilog HDL创建一个DFF（DFlip-Flop）实体DFF1，包括其输入CLK、D和输出Q。实体定义遵循IEEE STD_LOGIC_1164标准，并且在结构体部分，简单地将Q赋值为D，实现了DFF的基本逻辑功能。这个例子展示了数字逻辑设计的基础语法。

摘要生成于 C知道，由 DeepSeek-R1 满血版支持，前往体验 >

创建的实体名最好都是英文。或者英文、数字、下划线的组合也可以，不过要以字母开头。工程文件名称要与工程文件实体名称相同

--定义头文件
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;


--定义实体，定义输入和输出
ENTITY DFF1 IS
	PORT(CLK:IN STD_LOGIC;
		  D:IN STD_LOGIC;
		  Q:OUT STD_LOGIC);
END DFF1;


--定义结构体，定义实体内部的逻辑关系
ARCHITECTURE bhv OF DFF1 IS
 BEGIN
	Q <= D;
END bhv;

参考：quartus ii工程命名中：1工程所在文件夹名称；2工程命名；3工程文件实体名中英文要求都是如何？要分的直答_百度知道